drv/at91/at91_pit.h

   1 /**
   2  * \file
   3  * <!--
   4  * Copyright 2007 Develer S.r.l. (http://www.develer.com/)
   5  * This file is part of DevLib - See README.devlib for information.
   6  * -->
   7  *
   8  * \version $Id$
   9  *
  10  * \author Francesco Sacchi <batt@develer.com>
  11  *
  12  * AT91 periodic interval timer.
  13  * This file is based on NUT/OS implementation. See license below.
  14  */
  15
  16 /*
  17  * Copyright (C) 2007 by egnite Software GmbH. All rights reserved.
  18  *
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  21  * are met:
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  26  *    notice, this list of conditions and the following disclaimer in the
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  39  * OF USE, DATA, OR PROFITS; OR BUSINESS INTERRUPTION) HOWEVER CAUSED
  40  * AND ON ANY THEORY OF LIABILITY, WHETHER IN CONTRACT, STRICT LIABILITY,
  41  * OR TORT (INCLUDING NEGLIGENCE OR OTHERWISE) ARISING IN ANY WAY OUT OF
  42  * THE USE OF THIS SOFTWARE, EVEN IF ADVISED OF THE POSSIBILITY OF
  43  * SUCH DAMAGE.
  44  *
  45  * For additional information see http://www.ethernut.de/
  46  */
  47
  48 #ifndef AT91_PIT_H
  49 #define AT91_PIT_H
  50
  51 #include <cfg/compiler.h>
  52 /**
  53  *Periodic Inverval Timer Mode Register
  54  *\{
  55  */
  56 #define PIT_MR_OFF 0x00000000 ///< Mode register offset.
  57 #define PIT_MR     (*((volatile uint32_t *)(PIT_BASE + PIT_MR_OFF))) ///< Mode register address.
  58
  59 #define PIV_MASK   0x000FFFFF ///< Periodic interval value mask.
  60 #define PIV_SHIFT  0          ///< Periodic interval value shift.
  61 #define PITEN      24         ///< Periodic interval timer enable.
  62 #define PITIEN     25         ///< Periodic interval timer interrupt enable.
  63 /*\}*/
  64
  65 /**
  66  * Periodic Inverval Timer Status Register
  67  *\{
  68  */
  69 #define PIT_SR_OFF 0x00000004 ///< Status register offset.
  70 #define PIT_SR     (*((volatile uint32_t *)(PIT_BASE + PIT_SR_OFF))) ///< Status register address.
  71
  72 #define PITS       1          ///< Timer has reached PIV.
  73 /*\}*/
  74
  75 /**
  76  * Periodic Inverval Timer Value and Image Registers
  77  *\{
  78  */
  79 #define PIVR_OFF    0x00000008 ///< Value register offset.
  80 #define PIVR        (*((volatile uint32_t *)(PIT_BASE + PIVR_OFF))) ///< Value register address.
  81
  82 #define PIIR_OFF    0x0000000C ///< Image register offset.
  83 #define PIIR        (*((volatile uint32_t *)(PIT_BASE + PIIR_OFF))) ///< Image register address.
  84 #define CPIV_MASK   0x000FFFFF ///< Current periodic interval value mask.
  85 #define CPIV_SHIFT  0          ///< Current periodic interval value SHIFT.
  86 #define PICNT_MASK  0xFFF00000 ///< Periodic interval counter mask.
  87 #define PICNT_SHIFT 20         ///< Periodic interval counter LSB.
  88 /*\}*/
  89
  90 #endif /* AT91_PIT_H */